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数字设计原理与实践（第四版）
原著JohnF.Wakerly
8.13
Q3Q2Q1Q0的计数顺序为：
000010001001101010111100110111101111011101100101010000110010
00010000
按十进制表示的顺序为：08910111213141576543210
【注意RCO仅由QD、QC、QB、QA共同决定，与时钟触发与否无关。当UP/DN为1时，按升序计数，
此时若QD=QC=QB=QA=1，则RCO=0；当UP/DN为0时，按降序计数，此时若QD=QC=QB=QA=0，
则RCO=0】
8.16
【说明：原题目有误，应该是要求设计一个5位的LFSR，并写出从状态00001开始的前十个状态序列】
根据表8-26，5位LFSR计数器的反馈方程是：X5=X2⊕X0
方案一：采用2片四位移位寄存器74x194，逻辑电路图如下所示。其中，Reset=1时，加载预置数00001，
Reset=0时，执行左移计数。
方案二：采用1片四位移位寄存器74x194和1片带清零端的D触发器74x74，逻辑电路图如下所示。其
中，Reset=1时，加载预置数00001，Reset=0时，执行左移计数。
5
计数器输出X0X1X2X3X4的状态共有2-1=31个。
从状态00001开始的前十个状态序列是：
00001000100010001001100100010101011101100110011001
【其余的21个状态是：10011001110111111111111101110011000100010001100110
0110111011101110111011101110101010101010101000100010000】
8.27
【解题思路：教材图8-24已给出了采用T触发器设计的4位升序行波计数器，其输出Q3Q2Q1Q0的计数
顺序是0000~1111，十进制顺序为0~15。T触发器本身就是由D触发器构成的，因此，可将图8-24中的
T触发器改成D触发器。】
方案一：将每个触发器的Q输出端作为下一级触发器的时钟输入端，来实现降序计数。采用D触发器设
计的4位降序行波计数器的逻辑图如下：
DQQ0
CLKCLKQ
DQQ1
CLKQ
DQQ
2
CLKQ
DQQ
3
CLKQ
方案二：将升序0~15改为降序15~0，刚好是将升序序列取反，因此，可直接利用D触发器的QN输出端
来实现降序。采用D触发器设计的4位降序行波计数器的逻辑图如下：
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