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本申请提供一种FPGA的电路设计方法、ASIC原型验证方法及设计装置,所述方法包括:在多个FPGA的电路设计过程中例化目标ASIC中的控制寄存器列表以得到多个FPGA中各个FPGA各自对应的结构一致的目标控制寄存器列表;在各个FPGA的电路设计过程中将控制寄存器列表对应的控制总线进行复制以得到各个FPGA各自对应的目标控制总线;将各个FPGA各自对应的目标控制总线进行串联以得到各个FPGA各自对应的总线连接关系数据,以使得用户基于各个FPGA各自对应的设计好的目标控制寄存器列表、目标控制总线和总
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号CN117709261A
(43)申请公布日2024.03.15
(21)申请号202311420382.9
(22)申请日2023.10.30
(71)申请人中科驭数(北京)科技有限公司
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