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本发明公开了一种多核处理器高速访问控制方法、装置、存储模块及芯片,控制方法应用于第一单元和第二单元之间的信息交互。第一单元的存储空间被划分为多个子存储空间,第二单元包括多个处理器单元,每一个子存储空间与一个处理器单元相匹配。控制方法包括:在子存储空间存储的数据未进行更新的情况下,若发出请求的处理器单元访问过请求访问的子存储空间,发出请求的处理器单元不对请求访问的子存储空间进行访问。在子存储空间的数据没有更新的情况下,处理器单元可以通过读取自身的缓存来使用这些数据,而不需要再次对子存储空间的数据进
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号CN117609107A
(43)申请公布日2024.02.27
(21)申请号202311501889.7G06F12/14(2006.01)
(22)申请日2023.11.
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