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特权制造本教程仅用于配套BJ-EPMCPLD开发板学习交流使用
QuartusII调用ModelSim仿真实例
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版本信息
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参考资料：
《圣经》箴言九11“敬畏耶和华是智慧的开端，认识至圣者便是聪明。”/2522/
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下面是基于在AlteraQuartusII下如何调用第三方工具ModelSim进行仿真的一个实
例。
①打开QuartusII，新建一个工程，工程代码如下（只是做一个简单的二分频电路）：
modulemodelsim_test(
clk,rst_n,div
);
inputclk;//系统时钟
inputrst_n;//复位信号，低有效
outputdiv;//2分频信号
regdiv;
always@(posedgeclkornegedgerst_n)
if(!rst_n)div=1b0;
elsediv=~div;
endmodule
②进入菜单栏的AssignmentsEDAToolSettings，如图5.36所示。
图5.36第三方工具设置
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双击“EDAtools”下的“Simulation”选项，弹出如图5.37所示界面。
图5.37仿真工具设置
点击Toolname最右侧的下拉条，选择“ModelSim”,在弹出的界面如图5.38进行
设置。
《圣经》箴言九11“敬畏耶和华是智慧的开端，认识至圣者便是聪明。”/2522/
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图5.38ModelSim工具设置
③以上设置完成，重新编译工程。打开工程目录，看到多了一个“simulation”文件
夹，再打开该文件夹下的“modelsim”文件夹。看到有三个文件，其中.vo文件就是综
合后生成的网表。仿真还需要几个文件，我们把它们依次拷贝到该目录下。
a)、打开“C:\altera\70\quartus\eda\sim_lib”（具体quartus软件安装文件的根目
录视您的实际情况而定，大体路径都一样），因为我们用的是MAXII器件，所以把
“maxii_atoms.v”拷贝到“…simulation\modelsim”文件夹下，该文件是仿真元件库。
b)、编写设计工程的Testbench。这个实例的testbench代码如下：
modulevtf_test;
//Inputs
regclk;
regrst_n;
//Output
wirediv;
modelsim_testu1(
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.clk(clk),
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