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本发明请求保护一种基于FPGA的改进Delay‑FxLMS滤波器。本发明通过割集重定时技术重新分配延迟单元的位置,使算法结构流水化;将自适应延迟量设定为2,降低关键路径延迟,提高系统数据吞吐量;采用并行FIR滤波器结构,减少硬件电路寄存器工作频率,降低电路动态功耗。除此之外,将电路划分为多个数据处理模块,使滤波器权值局部更新,可在关键路径延迟不变下增添滤波阶数;利用DSP48E1模块完成信号与滤波系数之间乘加运算的并行处理,加快滤波器的处理速度,提高系统性能和效率。结果表明,该算法在压缩机降噪系
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号CN117353706A
(43)申请公布日2024.01.05
(21)申请号202311319727.1
(22)申请日2023.10.12
(71)申请人重庆邮电大学
地址400065
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