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2023-12-20 发布于四川
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基于全连接结构的L0 BTB容错设计系统及方法.pdf

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本发明涉及分支目标缓冲器容错设计领域，提出了一种基于全连接结构的L0BTB容错设计系统及方法，包括：将当前指令地址经过异或逻辑，获取当前指令地址的异或校验码；将当前指令地址和异或校验码拼接同时写入两个L0BTB；当前指令地址同时访问两个L0BTB，通过当前指令地址与目标指令地址进行比对，确定是否命中L0BTB；如果命中其中一个L0BTB，使能信号值为1，获取该表项内容并对该表项进行异或校验，如果该表项的异或校验值与表项中存储的校验值相同，则将该表项作为候选表项；根据获得的候选表项进行决

(19)国家知识产权局

(12)发明专利申请

(10)申请公布号CN117251313A

(43)申请公布日2023.12.19

(21)申请号202211438778.1

(22)申请日2022.11.17

(71)申请人北京轩宇空间科技有限公司

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