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本发明公开一种半导体器件及其制造方法,涉及半导体技术领域,以在解决具有不同厚度的栅堆叠结构的不同环栅晶体管之间的兼容性较差问题的同时,提高环栅晶体管的工作性能。半导体器件包括半导体基底,以及沿平行于半导体基底表面的方向间隔形成在半导体基底上的第一环栅晶体管和第二环栅晶体管。第一环栅晶体管和第二环栅晶体管均包括位于源区和漏区之间的至少一层纳米结构,第一环栅晶体管包括的纳米结构和第二环栅晶体管包括的纳米结构一体成型,第一环栅晶体管包括的每层纳米结构沿自身长度方向各部分的厚度均小于第二环栅晶体管包括的
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 117038673 A
(43)申请公布日 2023.11.10
(21)申请号 202311161632.1
(22)申请日 2023.09.08
(71)申请人 中国科学院微电子研究所
地址 1
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