FPGA设计与VHDL实现- 习题及答案王金明 ch04 VHDL设计初步.docx

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第四章 VHDL设计初步简答题用VHDL设计一个8位加法器，进行综合和仿真，查看综合和仿真结果。答：略。用VHDL设计一个8位二进制加法计数器，带异步复位端口，进行综合和仿真，查看综合和仿真结果。答：略。用VHDL设计一个模60的BCD码计算器，进行综合和仿真，查看综合和仿真结果。答：略。

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