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本发明提供一种屏蔽栅MOS器件及其制造方法,本发明中终端区开口的衬底侧壁上形成有牺牲氧化层和栅氧化层一起作为隔离氧化层,终端区开口内屏蔽栅与多晶硅栅之间也是形成有牺牲氧化层和栅氧化层一起作为隔离氧化层;而有源区内开口侧壁仅形成有栅氧化层。本发明在不增加有源区的栅氧化层厚度的前提下,增加了终端区内开口的衬底侧壁上的隔离氧化层厚度,增加了终端区开口内屏蔽栅与多晶硅栅之间的隔离氧化层厚度,从而解决了HTRB测试中终端区容易出现失效点的问题,提高了屏蔽栅MOSFET器件的合格率。
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 116779447 A
(43)申请公布日 2023.09.19
(21)申请号 202310946024.5
(22)申请日 2023.07.28
(71)申请人 上海华虹宏力半导体制造有限公司
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