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本发明提供一种时钟输入和输出零延时电路、封装芯片和电子设备，该电路包括：第一输入缓冲器、鉴相器、调相器和输出驱动器。首先输入时钟通过第一输入缓冲器缓冲，然后通过鉴相器比较第一输入缓冲器的输出信号和与所述调相器的输出信号相位相适配的时钟信号的相位，得到表示两者相位差的信号，再由调相器根据鉴相器的输出信号调整本地时钟的相位，最后通过输出驱动器转换调相器的输出信号的电平并驱动到芯片外，得到与输入时钟对齐且具有期望电平的输出时钟。本申请公开的上述方案电路结构简单，且在芯片内实现输入时钟和输出时钟的对齐，
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 113437953 A
(43)申请公布日 2021.09.24
(21)申请号 202110947206.5
(22)申请日 2021.08.18
(71)申请人 合肥新港海岸科技有限公司
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