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描述了用于对齐矩阵操作加速器瓦片的指令的装置、方法和系统。在一个实施例中，一种系统包括：矩阵操作加速器电路，其包括处理元件的二维网格、与处理元件的二维网格相耦合的表示第一二维矩阵的第一多个寄存器、以及与处理元件的二维网格相耦合的表示第二二维矩阵的第二多个寄存器；以及硬件处理器核心，其与矩阵操作加速器电路相耦合，并且包括：解码器电路，来将单个指令解码成经解码的指令，该单个指令包括识别第一二维矩阵的第一字段、识别第二二维矩阵的第二字段、以及操作码，该操作码指示出硬件处理器核心的执行电路将使得第三二维
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 114675883 A
(43)申请公布日 2022.06.28
(21)申请号 202111407206.2 (51)Int.Cl.
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