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本发明公开了一种基于三值忆阻器交叉阵列的数字同或与异或门实现方法。本发明采用4×3结构的三值忆阻器交叉阵列，其中两个作为输入忆阻器，一个作为输出忆阻器。本发明基于三值忆阻器交叉阵列的三值数字逻辑同或和异或门电路，结构清晰简单、易于实现。该同或门和异或门的交叉阵列实现对多值数字逻辑运算与存储一体化等诸多领域中的应用研究具有重要意义。
(19)国家知识产权局
(12)发明专利
(10)授权公告号 CN 113098492 B
(45)授权公告日 2022.07.26
(21)申请号 202110325167.5 US 2014028347 A1,2014.0
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