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本发明涉及一种采用多个环形延迟链的TDC电路系统，属于时间精密测量领域。该系统包括延迟器、与门电路和D触发器，且该系统通过将START信号同时引入环形结构的延迟线，然后在STOP信号来临时也同时引入各个延迟线上D触发器的时钟端口对延迟线状态进行采样，计算通过延迟单元的个数。本发明通过将每个环形延迟线的首个延迟单元以及末位的延迟单元用与门以及反相器代替，但延迟时间通过设计与其他延迟单元一致，这样此结构在不耗费其他资源的条件下，减少使用延迟单元以及触发器就达到了传统结构所达到的测量效果。
(19)中华人民共和国国家知识产权局
(12)发明专利
(10)授权公告号 CN 112506029 B
(45)授权公告日 2022.04.22
(21)申请号 202011460350.8 (56)对比文件
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