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8.5.2 基于Verilog HDL 的时序逻辑综合实验.pdf-丁磊-人民邮电出版社

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8.5.2 基于Verilog HDL 的时序逻辑综合实验.pdf-丁磊-人民邮电出版社

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    300数字逻辑与EDA设计9（2）了解利用EDA工具中的图形化设计界面进行综合设计。（3）了解芯片烧录的流程及步骤。（4）掌握分析问题、解决问题的综合能力，通过EDA工具设计出能解决实际问题的电路。二、实验环

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