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第40卷第12期 计算机科学 VoL40No．12
Science Dec2013
2013年12月 Computer
基于SIMD部件的四倍精度浮点乘加器设计
何军黄永勤朱英
(上海高性能集成电路设计中心 上海201204)
摘要如何减少四倍精度浮点运算的硬件开销和延迟是需要解决的重要问题。为减少四倍精度乘加器的硬件开
销，基于支持64位×4的双精度浮点SIMDFMA部件，设计并实现了一种新的四倍精度浮点乘加器(QPM)，来支
持4种浮点乘加运算和乘法、加减法、比较运算，运算延迟为7拍。通过将四倍精度113位×113位尾数乘法器分解为
仅与一个双精度浮点乘加器相当。与现有的Q]PM设计相比，相当工艺和频率下，其运算延迟减少了3拍，门数减
少了65．96％。
关键词浮点，SI加部件，乘加，四倍精度，高精度
中图法分类号TP332．2文献标识码A
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